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基于VHDL的DDS频率合成器的设计.doc

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    摘 要 本文以FPGA为硬件平台，基于EDA工具quartus II为软件平台上对DDS进行实现。用VHDL语言进行系统建模，对DDS进行参数设计，实现可重构的频率合成技术。能够根据需要方便的修改参数以实现期间的通用性，同时利用MAXPALLS编译平台完成一个具体的DDS设计仿真，详细阐述了基于VHDL编程的DDS设计方法步骤。直接数字频率合成信号发生器（Direct Digital Synthesize）以其使用方便和频率分辨率高等优点，在现代通信领域得到越来越广泛的应用。用VHDL语言对DDS进行功能描述，方便在不同的实现方式下移植和修改参数，因而逐步成为DDS设计主流。而且在Al

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