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万年历（平闰年判别闹钟）——基于中规模集成电路首先做个简单的秒表的逻辑电路，再逐步扩展其功能。利用两个异步置零十位计数器74LS160组成，其中左边的计个位，因为是十进，直接由本身的CO脚产生进位，自动置零。右边的计十位，六进，进位与置零都由组合电路译出。如图，下一个脉冲来后，应该是09了，事实上并非如此。变成19了，在下个脉冲，就变成10了为什么会这样呢，再仔细分析74160的时序图进位在计数计9的时候立刻产生。导致第二片74160的CLK有一个上升沿，计到一个数。我要的是08-09-10，而不是08-19-10啊，也就是说，置零的同时进位，怎样把进位延后一个脉冲呢？数电老师给了我一个答案，
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