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数电实验三 基于Quartus的硬件描述语言电路设计一 实验目的了解QuartusII的硬件描述语言电路。能用VHDl语言设计电路。二 实验设备实验电路开发板DEO，Quartus仿真软件。三 实验要求要求1：并用硬件描述语言实现异或门电路的设计。1）用QuartusII 波形仿真验证；2）下载到DE0 开发板验证。 要求2：，编写一个将二进制码转换成0-F 的七段码译码器。1）用QuartusII 波形仿真验证；2）下载到DE0 开发板验证。要求3：编写一个十六进制计数器。1）用QuartusII 波形仿真验证；2）下载到DE0 开发板验证。要求4：编写一个能实现占空比50%的5M 和50M 分频器即两个输出，输出信号频率分别为10Hz 和1Hz。1）下载到DE0 开发板验证。扩展内容：利用已经实现的VHDL模块文件，采用原理图方法，实现0-F计数自动循环显示，频率10Hz。四 实验内容异或门波形仿真为：0-F 的七段码译码器LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY exa3_2 ISPORT (data_in:IN STD_LOGIC_VECTOR(3 DOWNTO 0);dis_out:OUT STE_LOGIC_VECTOR(6 DOWNTO 0));END exa3_2;ARCHITECTURE fwm OF exa3_2 ISBEGINPROCESS(data_in)BEGINCASE data_in ISWHEN”0000”=dis_out=”1000000”;--显示 0WHEN”0001”=dis_out=”1111001”;--显示 1WHEN”0010”=dis_out=”0100100”;--显示 2WHEN”0011”=dis_out=”0110000”;--显示 3WHEN”0100”=dis_out=”0011001”;--显示 4WHEN”0101”=dis_out=”0010010”;--显示 5WHEN”0110”=dis_out=”0000010”;--显示 6WHEN”0111”=dis_out=”1111000”;--显示 7WHEN”1000”=dis_out=”0000000”;--显示 8WHEN”1001”=dis_out=”0010000”;--显示 9WHEN”1010”=dis_out=”0001000”;--显示 AWHEN”1011”=dis_out=”0000000”;--显示 BWHEN”1100”=dis_out=”1000110”;--显示 CWHEN”1101”=dis_out=”1000000”;--显示 DWHEN”1110”=dis_out=”0000110”;--显示 EWHEN”1111”=dis_out=”0001110”;--显示 FWHEN OTHERS= dis_out=”1111111”;--灭灯，不显示END CASE;END PROCESS;END fwm;说明: 七段码译码器由7个线段状的LED组成，1表示熄灭，0表示点亮，利用不同位置的LED熄灭和点亮组成0~F字符显示；将每一个四位二进制码对应一个相应的七段码输出；波形仿真如下：十六进制计数器LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY exa3_3 ISPORT ( clk,RST : IN STD_LOGIC;DOUT : OUT STD_LOGIC_VECTOR (3 DOWNTO 0); --四位计数COUT : OUT STD_LOGIC); --进位位END exa3_3;ARCHITECTURE fwm OF exa3_3 ISSIGNAL Q1 : STD_LOGIC_VECTOR (3 DOWNTO 0);BEGINPROCESS(clk,RST)BEGINIF RST = 0 THEN Q1=(OTHERS = 0); COUT= 0;ELSIF clkEVENT AND clk=1 THENQ1=Q1+1;COUT= 0;IF Q1 = 1111 THEN Q1=(OTHERS = 0); COUT= 1;END IF;END IF;END PROCESS;DOUT=Q1 ;END fwm;说明： Count为进位输出； Rst为清零信号，为0时清零；每计数到1111时,输出count=1,Q=0000;波形仿真：4， 分频器LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY exa3_4 ISPORT(clk:IN STD_LOGIC;A,B