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第二章 计算机中的信息表示一.数值型数据的表示方法1.进位计数制及其相互转换（二---八---十---十六进制间的转换）2.IEEE754标准浮点表示格式按IEEE754标准，常用的浮点数的格式如图所示。 数符阶码E尾数M IEEE754标准浮点格式IEEE754有3种浮点表示格式，分别称为：短浮点数(或称短实数)、长浮点数（或称长实数）、临时浮点数（或称临时实数）。它们的具体格式如表所示。IEEE754的3种浮点表示格式类型数符（位）阶码（位）尾数数值（位）总位数（位）偏 置 值十六进制十进制短浮点数长浮点数临时浮点数111811152352643264807FH3FFH3FFFH127102316383例：将(82.25)10 转换成短浮点数格式。1）先将(82.25)10 转换成二进制数 (82.25)10 =(1010010.01)2 2）规格化二进制数(1010010.01)2 1010010.01=12 63）计算移码表示的阶码=偏置值+阶码真值： (127+6)10=(133)10 =24）以短浮点数格式存储该数 因此：符号位=0 表示该数为正数 阶码 由3）可得 尾数=01001001000000000000000 由2）可得；尾数为23位，不足在后面添15位0 所以，短浮点数代码为： 001001001000000000000000 表示为十六进制代码为：42A48000H二．指令信息的表示 主存开辟（软堆栈）堆栈 CPU中的寄存器组组成（硬堆栈） 寄存器 CPU中的寄存器1.操作数的位置 外设接口中的寄存器 存储器 主存（包括cache） 外存 CPU内的寄存器 主存 2.CPU能直接访问的操作数位置 主存 Cache 外设接口中的寄存器（统一编址）结论：①CPU能够直接访问的操作数只能存放在主存储器或CPU内的寄存器中，②由于主存储器的容量远远大于CPU内的寄存器的容量，因此CPU能够直接访问的操作数主要存放在主存储器中。 显式：直接、间接、变址、基址等3.指令给出操作数地址方式 隐式：隐含约定寄存器号、主存储器单元号简化地址结构的基本途径：尽量使用隐地址。4.寻址方式大致可将众多的寻址方式归纳为以下四大类，其它的寻址方式则是它们的变型或组合。① 立即寻址。在读取指令时也就从指令之中获得了操作数，即操作数包含在指令中。② 直接寻址类。直接给出主存地址或寄存器编号，从CPU内或主存单元内读取操作数。③ 间接寻址类。先从某寄存器中或主存中读取地址，再按这个地址访问主存以读取操作数。④ 变址类。指令给出的是形式地址（不是最终地址），经过某种变换（例如相加、相减、高低位地址拼接等），才获得有效地址，据此访问主存储器以读取操作数。第三章 CPU子系统（复习）一、CPU的逻辑组成及工作机制1.CPU的逻辑组成（模型机框图）（1）CPU的逻辑组成→模型机框图；（2）CPU内每个寄存器的作用；（3）总线的分类及定义；（4）控制器的分类及区别；2.CPU的指令流程（1）指令类型：MOV指令、双操作数算数逻辑运算指令、单操作数算是逻辑运算指令、转移/返回指令、转子指令；（2）核心是寻址方式：立即寻址、R、(R)、—(R)、(R)+、@(R)+、X(R)；3.操作时间表的安排（微命令的安排）：（1）CPU数据通路操作：按照数据的流向分成四段ALU输入选择→AUL功能选择→移位器功能选择→分配脉冲（打入到寄存器中的脉冲）；（2）与访问主存有关的微命令；例：M→MDR→CFT: M→IR、PC+1→PCET: SR . /DR ： Ri OP D→MDR , MDR→M , PC→MAR 或/SR . /DR : C OP D→MDR , MDR→M , PC→MAR二、基本概念1.同步控制，异步控制？有何主要特征？应用场合？2.主/从设备，试举例说明。3.组合逻辑控制器、微程序控制器的时序系统是如何划分的？4.微命令、微操作、微指令、微指令周期、微程序？5.微程序控制器的基本思想。6.1位全加器的结构及关系表达式。7.并行加法器中的串行进位链结构：Cn = Gn + PnCn-1并行进位链结构：Cn = Gn + PnGn-1+ … + Pn…P1C0第四章 存储系统（复习）一、本章的重点：主存的逻辑设计1.总容量：即字数×位数2.需要确定可供选用的存储芯片，即什么类型、型号的存储芯片：(1)位扩展(2)字数(编址空间)扩展3.总线：地