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2017-10-07 发布于湖北
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Altera FPGA加密中文

使用 Altera FPGA 中的设计安全特性 AN-556-2.0 应用笔记 ® 本应用笔记介绍了如何使用 Altera 40- 和 28-nm FPGA 中的设计安全特性来保护您的设计免受非法复制、逆向工程以及配置文件的篡改。此外，本应用笔记也阐述了 40- - 和 28 nm FPGA 设计安全特性对硬件以及软件的要求，并对实现一个安全配置流程所需要的步骤作了介绍。 1 本应用笔记使用术语“40-nm”或者“28-nm” FPGA。表 1列出了所支持的FPGA及其适用的器件。表 1. 所支持的 FPGA FPGA 器件 ® ® 40 nm Arria II 和 Stratix IV 28 nm Stratix V及之后的系列本应用笔记涵盖以下几方面内容： ■ “ 设计安全特性的概述”第 2 页 ■ “ 硬件和软件要求 ”第 4 页 ■ “ 实现安全配置流程的步骤”第 5 页 ■ “ 所支持的配置方案”第 25 页 ■ “ 安全模式验证”第 26 页 ■ “ 加密功能已使能的串行闪存加载支持 ”第 29 页 ■ “28-nm FPGA 的 JTAG 安全模式 ”第 32 页 ■ “ 美国出口控制”第 32 页在当下竞争日益激烈的商业以及军事环境中，设计安全对于数字设计人员而言是一个至关重要的考虑因素。随着 FPGA 在更庞大、更关键的系统组件中扮演着愈来愈重要的角色，保护设计免受非法复制、逆向工程以及篡改也愈加显得重要。FPGA 通过使用 256-bit 高级加密标准（AES）算法 ( 一个行业标准的加密算法 ) 来对配置比特流进行解密能力可以消除这些顾虑。 © 2011 Altera Corporation. All rights reserved. ALTERA, ARRIA, CYCLONE, HARDCOPY, MAX, MEGACORE, NIOS, QUARTUS and STRATIX are Reg. U.S. Pat. Tm. Off. and/or trademarks of Altera Corporation in the U.S. and other countries. All other trademarks and service m