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高速数据连接：不仅仅是硬件 法律声明  专有信息说明，免责与免除担保 ADI演示文稿是ADI公司的财产。ADI演示文稿以及ADI提供或在此处使用的软件、文本、图片、设计元素、音频和所有 其他资料（简称“ADI信息”）的所有版权、商标和其他知识产权和所有权均属ADI公司及其许可人所有。事先未经ADI 书面许可，不得以任何方式、通过任何形式或媒介复制、出版、改编、修改、展示、分发或销售ADI信息。 ADI信息和ADI演示文稿均按“原样”提供。尽管ADI希望ADI信息和ADI演示文稿准确无误，但ADI不对ADI演示文稿和 ADI信息作任何担保，包括但不限于关于准确性和完整性的担保。排字错误和其他失误都可能存在。ADI不保证ADI信息 和ADI演示文稿能满足您的要求、准确、不会中断或不存在错误。ADI不对适销性、特定用途实用性或不侵犯任何第三方 知识产权作任何明示或暗示的担保。对于因您使用ADI信息和ADI演示文稿而引起的或与其相关的任何损害或损失，包括 但不限于数据丢失或损坏、电脑病毒、错误、遗漏、中断、缺陷或其他故障，无论此等责任属于侵权、合同或其他， ADI均不承担任何责任。使用其中提到的任何第三方参考软件须遵循与此等第三方签订的适用许可协议（若有）。 ©2013 Analog Devices, Inc. 保留所有权利 2 今日议程 高速转换器接口方式和标准 详细讨论JESD204B转换器转到FPGA串行接口 FPGA转换器系统设计支持产品  评估板和参考设计板  软件和器件驱动器  HDL接口模块  在线技术支持和文档 3 FPGA转ASIC 的微控制器从微控制器到FPGA再到 ASIC ：权衡 微控制器 DSP FPGA ASIC 潜在信号处理和转换器性能 开发成本 潜在I/O性能 开发便利性 材料成本 4 ADC输出配置 并行 串行LVDS SerDes/JESD204 N DCO F数据 FCLK F数据 ADC ADC ADC F数据 DCO PLL PLL Fs Fs Fs  并行CMOS  F数据最大= 1 + Gbps  F数据= 6.25+ Gbps  F数据最大= 150 MSPS  编码串行CML  串行LVDS  Fs最大= 数据包长度+ 开  DDR LVDS  Fs最大= F数据 ×数据通 销(overhead)？？？？？  F数据最大= 420 MSPS 道数/ADC分辨率  需要片内PLL  提供低成本FPGA接口  需要片内PLL