4-1 组合电路课件.pptVIP

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2017-08-12 发布于河南
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4-1 组合电路课件

第四章;4-1 組合電路;4-3 設計步驟;BCD碼到超3碼轉換器;BCD到超3碼卡諾圖;BCD到超3碼電路圖;4-4 二進位加法器---減法器;半加法器;全加法器;全加法器;全加法器;二進位加法器;進位傳播;進位遞迴產生器;具有進位遞迴的4位元加法器;二進位減法器;4-5 十進位加法/器;BCD加法器電路;4-6 二進位乘法器;4位元乘3位元之二進位乘法器;4-7 大小比較器;4位元大小比較器;4-8 解碼器;具有致能輸入之2對4線解碼器;利用3x8解碼器建立4x16解碼器;利用解碼器實現組合邏輯電路;4-9 編碼器 ;優先權編碼器之真值表;優先權編碼器卡諾圖;4輸入優先權編碼器;4-10 多工器(Multiplexers);4對1線多工器;四重2對1線多工器;利用多工器實現布林函數;利用多工器實現一個4輸入函數;三態閘;利用三態閘構成多工器;4-11 組合電路的硬體描述語言;HDL 範例 4-1(2對4線解碼器的閘階層描述);HDL 範例 4-1(2對4線解碼器的閘階層描述);HDL 範例 4-2(4位元加法器之底部向上層次化描述);HDL 範例 4-2(4位元加法器之底部向上層次化描述);HDL 範例 4-2(4位元加法器之底部向上層次化描述);HDL 範例 4-2(4位元加法器之底部向上層次化描述);三態閘;具有三態緩衝器之2對1線多工器;資料流程模型;HDL 範例 4-3(2對4線解碼器的資料流程描述);HDL 範例 4-4(4位元加法器之資料流程描述);HDL 範例 4-5(大小比較器之資料流程描述);HDL 範例 4-6(2對1線多工器使用條件式運算子描述);行為模型;HDL 範例 4-8(4對1線多工器之行為描述);HDL 範例 4-8(4對1線多工器之行為描述);測試平台;系統功能;模擬與設計的交互模組;HDL 範例 4-9(測試範例4-6所描述的2對1多工器);HDL 範例 4-9(測試範例4-6所描述的2對1多工器);HDL 範例 4-9(測試範例4-6所描述的2對1多工器);HDL 範例 4-9(測試範例4-6所描述的2對1多工器);HDL 範例 4-9(測試範例4-6所描述的2對1多工器);HDL 範例 4-10(全加法器之多階電路的閘階層描述);HDL 範例 4-10(全加法器之多階電路的閘階層描述);HDL 範例 4-10(全加法???之多階電路的閘階層描述);HDL 範例 4-10(全加法器之多階電路的閘階層描述);HDL 範例 4-10(全加法器之多階電路的閘階層描述)