基于现场可编程门阵列的RISC 处理器设计 - 计算机工程.PDFVIP

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2017-07-03 发布于天津
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基于现场可编程门阵列的RISC 处理器设计 - 计算机工程

第37 卷第 11 期计算机工程 2011 年 6 月 Computer Engineering June 2011 Vol.37 No.11 文献标识码文献标识码：：A 文献标识码文献标识码：：中图分类号中图分类号：：TP332.3 文章编号文章编号：：1000——3428(2011)11——0242——03 中图分类号中图分类号：： ·工程应用技术与实现·工程应用技术与实现 ·· 文章编号文章编号：： —— —— —— ··工程应用技术与实现工程应用技术与实现 ·· 基于基于现场可编程门阵列现场可编程门阵列的的 RISC 处理器处理器设计设计基于基于现场可编程门阵列现场可编程门阵列的的处理器处理器设计设计东野长磊东野长磊东野长磊东野长磊 (山东科技大学信息科学与工程学院，山东青岛 266510) 摘摘要：要：基于现场可编程门阵列(FPGA)平台，设计嵌入式精简指令集计算机(RISC) 中央处理器(CPU) 。参考无内部互锁流水级微处理器摘摘要要：： (MIPS)指令集制定原则设计 CPU 指令集，通过分析指令处理过程构建嵌入式 CPU 的 5 级流水线，结合数据前推技术和软件编译方法解决流水线相关性问题，并实现 CPU 的算术逻辑单元、控制单元、指令 cache 等关键模块设计。验证结果表明，该嵌入式RISC CPU 的速度和稳定性均达到设计要求。关键词关键词：现场可编程门阵列：；精简指令集计算机处理器；流水线相关性；算术逻辑单元关键词关键词：： Design of Reduced Instruction Set Computer Processor Based on Field Programmable Gate Array DONGYE Chang-lei (College of Information Science and Engineering, Shandong University of Science and Technology, Qingdao 266510, China) 【【Abstract 】】This paper designs a embe ed Reduced Instruction Set Computer(RISC) Central Processing Unit(CPU) based on Field Programmable 【【】】 Ga