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变模计数器设计
武汉理工大学数字电子技术基础课程设计报告姓名：班级：学号：指导老师：华剑一.设计要求设计一个变模计数器当：X=0时，实现七进制加计数X=1时，实现五进制加计数二.设计思路计数器最大为七进制，因此采用四位二进制计数器即可实现。因此采用74LS161来进行设计。三．元器件介绍1.74LS161原理图和管脚图74LS161逻辑功能表2.或门3.与非门4.单刀双掷开关5.函数发生器6.显示译码器三.电路模块设计1.时钟信号输入2.数字显示电路3.同步置0电路四.电路图五.工作过程1.X=0时，显示译码器从0到6依次循环显示计数器从零开始计数。当QDQCQBQA=0110时，经过或门和与非门得到低电平信号，使得LD=0，计数器置0。接下来又从0开始循环计数。2.X=1时，显示译码器从0到4依次循环显示计数器从零开始计数。当QDQCQBQA=0100时，经过或门和与非门得到低电平信号，使得LD=0，计数器置0。接下来又从0开始循环计数。六.仿真 经过仿真软件模拟，可以实现所要求实现的功能，设计成功。
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