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Next Generation UPA 200Mbps Powerline Chipset ? DS2 2007. Reproduction prohibited Chipset Overview Two-chip solution (Aitana) (Digital Front End and Analog Front End) Digital Front End Integrated Circuit Analog Front End Integrated Circuit ? DSS9101 ? DSS7800 ?Integrated DAC/ADC ? Fully Integrated AFE ? 0.13 μm technology ? Commercial temperature range ? Commercial temperature ? Ultra low noise range ? Mainly In-Home ?In-Home ?7 × 7 mm ? 24 × 24 mm ? DS2 2007. Reproduction prohibited Illegal copy if not held by customer Feature Comparison DSS9101 DSS9010 PLC PHY layer 200 Mbps PHY 200 Mbps PHY Direct PLC 32 16 connections MAC Table Size 64 32 Data Bus Width 16 16 VLANs 16 4 QoS priorities 8