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FPGA开发技术框架 一．开发流程： 需求定义 明确系统的性能指标和实现目标。 RTL级HDL描述 描述寄存器与寄存器之间的逻辑功能，用综合工具生成门级网表，描述系 统的功能框架。 功能仿真 验证RTL级描述是否与设计意图一致。 管脚分配与设计约束 将设计文件的输入输出信号指定到器件的某个管脚，设置此管脚的电平标 准，设计时序约束，和综合、布局布线的其他约束。 综合 将RTL级HDL语言翻译成由与、或、非等基本逻辑单元组成的门级连接 并优化，生成门级网表文件。 门级仿真 检查综合结果是否与设计一致。 布局布线 将生成的网表和寄存器资源合理配置。 时序/时延分析 获得布局布线后系统的延迟信息，发现时序违规，较好的反应系统的实际 工作情况。 配置与下载 通过Programmer将布局布线后的配置文件下载到FPGA上，对硬件进行 编程，一般配置文件为.POF或者.SOF格式，下载分为AS,PS,JTAG等方 式。 开发工具： FPGA常用开发软件 集成的PLD/FPGA开发环境 这类软件都是由PLD/FPGA芯片厂家提供，基本都可以完成所有的设计输入（原理图或HDL)，仿真，综合，布线，下载等工作。 Altera公司上一代的PLD开发软件，使用者众多。目前Altera已经停止开发MaxplusII，而转向QuartusII软件平台 MaxplusII学习资料下载 MaxplusII Baseline Altera公司的免费PLD开发软件，界面与标准版的MaxplusII完全一样，但需要通过使用MAX+PLUSII Advanced Synthsis插件才能支持VHDL/Verilog。 该支持MAX7000/3000和部分FLEX/ACEX芯片（如1K30,6016等），共47.1M 用网卡号申请license 如没有网卡，可以用硬盘号申请，license会发到你的电子信箱,有效期为6个月，到期后可再申请 MaxplusII E+MAX Altera公司的免费PLD开发软件，界面与标准版的MaxplusII完全一样，只支持MAX7000和MAX3000系列器件，本身支持不复杂的VHDL和Verilog综合，软件较小，共26.8M 用网卡号申请license ，如没有网卡，可以用硬盘号申请，其他同上 Altera公司新一代PLD开发软件，适合大规模FPGA的开发 QuartusII学习资料下载 QuartusII Web Edition Altera公司的meifeui PLD开发软件QuartusII的免费版本，推荐使用256M以上内存，安装有NT或win2000的机器 用网卡号申请license license有效期为150天，到期后可再申请 Xilinx公司上一代的PLD开发软件，目前Xilinx已经停止开发Foundation，而转向ISE软件平台 Foundation学习资料下载 Xilinx公司目前的PLD开发软件 ISE4.1中文学习资料 WebFITTER Xilinx公司的免费PLD开发软件,不需下载，可在线编译，结果用e-mail发送到信箱。使用简单，但要求较快的联网速度。支持XC9500 和 CoolRunner系列 不需要安装license，但必须注册,申请用户和password WebPACK ISE Xilinx公司的免费PLD开发软件,支持XC9500,coolrunner,Spartan/II,部分Virtex/E/II器件 ? ispDesignEXPERT Lattice公司的PLD开发软件,目前必威体育精装版软件改名为：ispLEVER ? ispLEVER Starter Lattice公司的免费PLD开发软件,支持600个宏单元以下的Lattice芯片的设计 需要注册 license有效期为6个月，到期后可再申请 Wrap Cypress公司开发软件 ? ? ACTEL公司开发软件 ? ? Quicklogic公司开发软件 ? ABEL4.0 开发GAL/PAL的软件，DOS界面 免费 ABEL5.0 开发GAL/PAL的软件，DOS界面 免费 为了提高设计效率，优化设计结果，很多厂家提供了各种专业软件，用以配合PLD/FPGA芯片厂家提供工具进行更高效率的设计，最常见的组合是：同时使用专业HDL逻辑综合软件和PLD/FPGA芯片厂家提供的软件。 ? HDL前端输入与系统管理软