数字逻辑原理与实践3-3课程方案.ppt

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2017-05-04 发布于湖北
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Class Exercise ;Answer key;CMOS Steady-State Electrical Behavior ( CMOS稳态电气特性） Logic Levels （逻辑电压电平） Noise Margin （噪声容限）;VOUT = 0;非理想输入时的电路特性输入偏离供电轨道，输出电压变坏;Fan-Out（扇出）当输出负载大于它的扇出能力时？？输出特性变差电流?，功耗 ?，温度升高传输延迟、转换时间变长 Unused Inputs (不用的CMOS输入端如何处理？？);EXAMPLE 2 (P107);3.6 CMOS Dynamic Electrical Behavior (CMOS动态电气特性);Transition Time (转换时间);VCC = + 5.0V;Propagation Delay (传播延迟);Power Consumption (功率损耗);Power Consumption (功率损耗);动态功耗的来源：两个管子瞬间同时导通产生的功耗 PT 对负载电容充、放电所产生的功耗 PL;3.7 Other CMOS Input and Output Structures （其他CMOS输入输出结构） (P129);Transmission Gates (传输门);3.7.1 Transmission Gates(传输门);3.7.2 Schmitt-Trigger Inputs(施密特触发器输入)(P130);Schmitt-Trigger Inputs(施密特触发器输入);Example 2;Applications of Schmitt-Trigger (施密特触发器的应用);脉冲整形;脉冲鉴幅;3.7.3 Three-State Outputs (三态输出)(P373);Three-State Outputs (三态输出);输出电平？？造成逻辑混乱;A;A;3.9 Low-voltage CMOS Logic and interfacing 低电压CMOS逻辑和接口(P151);3.10 Bipolar Logic (双极逻辑)(P156);3.10 Bipolar Logic (双极逻辑);Diode Logic (二极管逻辑);3.10.2 Bipolar Junction Transistors (双极结型晶体管)(P158);Schottky Transistors (肖特基晶体管);逻辑系列;3.10.8 CMOS/TTL interfacing (P169);74HCT驱动74LS 高态: 3.84 – 2.0 = 1.84V 低态: | 0.33 – 0.8 | = 0.47V;74HCT驱动74LS 低态扇出：