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2015-09-27 发布于重庆
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Synthesis of Concurrent System Interface Modules with Automatic Protocol Conversion Generat.pdf

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Synthesis of Concurrent System Interface Modules with Automatic Protocol Conversion Generat

Synthesis of Concurrent System Interface Modules with Automatic Protocol Conversion Generation Bill Lin Steven Vercauteren IMEC, Kapeldreef 75, B-3001 Leuven, Belgium, Email:fbilllin,vercaut g@imec.be Abstract — We describe a new high-level compiler called Integral reset for designing system interface modules. The input is a high-level con- Host start current algorithmic speciﬁcation that can model complex concurrent control ﬂow, logical and arithmetic computations, abstract communi- done reset start cation, and low-level behavior. For abstract communication between done two communicating modules that obey different I/O protocols, the Req necessary protocol conversion behaviors are automatically synthe- SRC31:0 Ack sized using a Petri net theoretic approach. We present a synthesis Optical rcvD DATA31:0 trajectory that can synthesize the necessary hardware resources, con- Link trol circuitry, and protocol conversion behaviors for impl ementing Storage FIFOs system interface modules.