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2015-09-24 发布于重庆
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高速低功耗钟控比较器的设计.pdf

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技术专栏 Technolo盱Column 高速低功耗钟控比较器的设计李亮1，臧佳锋1，徐振3，韩郑生2，钟传杰1 (1．江南大学，江苏无锡214000；2．中国科学院微电子研究所，北京100029； 3．无锡友芯集成电路设计有限公司，江苏无锡214000) 摘要：在分析各种比较器的基础上，设计了一种高速低功耗的钟控比较器，着重优化了比较器的速度和功耗。在SMIC O．35弘mn阱CMOS工艺条件下，采用CadenceSpectre对电路进行了模拟。结果表明，比较器的最高工作频率为200MHz，精度为0．3rnV，在3．3V的电源电压下，功耗仅为0．4mW。关键词：钟控比较器；失调电压；正反馈；差分放大器中图分类号：耶M31 文献标识码：A 文章编号：1003．353x(2008)01．0011．04 of Low-P0werClocked Desigll High-Speed C咖parator Li xu Han Lian91，zangJiafen91，zhen3， zhengshen孑，zhongchuanjiel o， (1．勘幽em玩，样钟№毋，‰i21加00，吼iM；2．加疵啪矿肘跏8k加凡洒，仇i嬲eAc口demy 100029，吼打m；3，阮i co．，删．，黜i214000，吼i船) Sc诸耽∞，＆驷w sDc砒咖，c踟话m Abs咖ct：A clocked was allsortsof low—power conlp锄tordesigIledby high—speed aIlalyzing with on the and ofthe Basedon SMIC conlparators，emphasisoptirnizingspeedpower coInparator． 0．35弘m n—weIl was that tllecircuit8iInulatedCadence Resultsshow thema】【imum technology， by spectre． operating ofthe is200 i80．3 is 0．4mWat MHz，r}esolutionmv，and 舶quency comp锄tor powerconsumptionoIIly 3．3V． words：clocked ofbets feedback；diffellential Key coⅡlparator； V01tage；positive amplifier EEACC：1265A：1265B 预