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芯创电子手把手教你学习FPGA—代码规范篇.pdf
2013
芯创电子FPGA 开发板配套教程
手把手教你学习FPGA—代码规范篇
或许您可能听说过FPGA,但不是很了解;或许您已经知道FPGA 的
存在,但没有掌握这门技术;或许您打算在不久的将来对FPGA 进
行初步尝试;不管怎样,只要您对FPGA 感兴趣,那么就让我们一
起踏出通往FPGA 世界的第一步,芯创电子手把手教你学习FPGA。
芯创电子工作室
51FPGA
2013/3/3
芯创电子FPGA 开发板配套教程 2013
目录
1. 代码规范目的3
2. 代码规范范围3
3. 代码规范内容3
3.1 标准的文件头3
3.2 标准的module 格式3
3.3 命名规则4
3.4 线网和寄存器4
3.5 可综合语句的使用4
3.6 条件语句的使用5
3.7 重用化设计5
3.8 参数化设计5
3.9 同步设计5
3.10 代码注释6
3.11 空行和空格6
3.12 排版6
4. 小结7
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芯创电子FPGA 开发板配套教程 2013
1. 代码规范目的
本规范的目的是提高书写代码的可读性、可修改性、可重用性,优化代码综
合和仿真的结果,指导设计工程师使用VerilogHDL规范代码和优化电路,规范
可编程技术的VerilogHDL设计输入,从而做到:1.逻辑功能正确,2.提高整洁
度,3.便于跟踪、分析、调试,4.增强可读性,帮助阅读者理解,5.便于程序维
护,6. 便于整理文档,7. 便于交流合作。
2. 代码规范范围
本规范涉及Verilog HDL编码风格,编码中应注意的问题,Testbench 的编码
等。本规范适用于Verilog model 的任何一级(RTL ,behavioral, gate_level) ,也适
用于出于仿真、综合或二者结合的目的而设计的模块。
3. 代码规范内容
3.1 标准的文件头
在每一个版块的开头一定要使用统一的文件头,其中包括作者名,模块名,
创建日期,所属项目,概要,更改记录,版权等必要信息。
3.2 标准的module 格式
(1) module 例化名用xx_u 标示(多次例化用次序号0,1,2…) 。
(2 ) 建议每个模块加timescale 。
(3 ) 不要书写空的模块,即一个模块至少要有一个输入一个输出。
(4 ) 为了保持代码的清晰、美观和层次感,一条语句占用一行,每行限制
在80 个字符以内,如果较长则要换行。
(5 ) 采用基于名字(name_based)的调用而非基于顺序的(order_based)的
调用。
(6 ) 模块的接口信号按输入、双向、输出顺序定义。
(7 ) 使用降序定义向量有效位顺序,最低位是0 。
(8 ) 管脚和信号说明部分,一个管脚和一组总线占用一行,说明清
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